先進封裝是什麼?技術原理、應用與對 AI 晶片的影響
認識先進封裝的 2.5D/3D 互連、CoWoS、InFO 與 SoIC,了解它如何整合運算晶粒和 HBM、影響 AI 晶片的頻寬與設計,以及熱管理、測試、成本和良率的取捨。
晶圓代工,是由專業半導體製造廠依照客戶的晶片設計,在矽晶圓上製作積體電路,再經測試與封裝等流程交付的服務。簡單說,晶片公司負責想好「電路要怎麼設計、晶片要做什麼」,晶圓代工廠則提供工廠、製程技術與量產能力,把設計轉成晶片。手機處理器、通訊晶片、AI 加速器等產品,都可能採用這種分工。

| 角色 | 主要工作 | 一般人可以這樣理解 |
|---|---|---|
| 無晶圓廠(Fabless) | 設計晶片、定義功能與規格,再委託製造。 | 畫好電路藍圖並決定晶片要解決的問題。 |
| 晶圓代工(Foundry) | 依客戶設計與選定製程,在晶圓上製造晶片。 | 提供製造產線,把藍圖做成實際電路。 |
| 整合元件製造商(IDM) | 同一家公司可能同時從事晶片設計與製造。 | 設計與生產都在企業內部進行,具體分工依公司而異。 |
| 封裝與測試(OSAT/測試服務) | 將晶圓切成晶粒,封裝並進行電性或功能測試。 | 讓裸晶能連接到電路板或其他晶粒,並確認是否符合規格。 |
這種分工的關鍵價值,在於晶片設計公司不必各自投入資金興建整座晶圓廠。台積電的公司介紹指出,專業晶圓代工模式降低了成立晶片設計公司的門檻,讓設計公司可以把資源放在產品與電路設計;台積電的專業晶圓代工說明也介紹了這種模式對產業的影響。實際合作並非只有「送圖、拿晶片」:客戶與代工廠還要確認製程規則、設計工具、IP、產能安排、良率目標、品質規格與交期。
製程從高度平整的矽晶圓開始。工廠會在晶圓表面反覆形成薄膜、塗佈光阻、以光刻把圖形轉印到表面,再透過蝕刻、離子植入、清洗、沉積及其他材料處理,逐層建立電晶體與連線結構。每一層都必須和既有圖案精準對位;細微污染、尺寸偏差或材料變化,都可能讓部分晶粒失效。
光刻可以想成用光把電路圖案投影到感光材料上,但它只是整條製程中的一個環節。ASML 的光刻原理說明指出,光學系統會把光罩上的圖案縮小並聚焦到晶圓上;晶片製造還包括沉積、光阻、蝕刻、離子植入、量測與檢查等工作。代工廠的任務不是單純操作一台曝光機,而是把許多製程步驟、材料、設備與製程控制整合成可重複的量產流程。
晶圓上會重複排列許多晶粒(die)。完成製程後,廠商會先測試晶粒,再切割與封裝。良率通常指投入的晶粒中,符合指定品質或電性條件的比例;它會受設計、製程成熟度、缺陷、晶粒大小與測試標準等因素影響。良率高低會影響可交付數量、成本與供貨穩定度,但單看一個百分比不足以判斷一家廠或一款晶片的整體競爭力,因為不同產品的尺寸、規格和測試條件可能不同。
手機系統單晶片(SoC)可能整合 CPU、圖形處理、影像、通訊與其他控制功能,重視效能、耗電、晶片面積和散熱間的平衡。AI 加速器則需要處理大量平行運算,常會同時考慮運算晶粒、記憶體頻寬、封裝連線與能源效率。兩者用途不同,代工廠需按照客戶需求提供合適的製程平台與量產支援;並非所有手機晶片或 AI 晶片都使用同一種製程,也不是每顆都追求最先進節點。
部分 AI 系統會將運算晶粒與高頻寬記憶體等元件整合在同一封裝中,透過先進封裝改善元件間的連接方式。這會使「製造」延伸到晶圓完成後的切割、封裝與測試。Intel Foundry 的官方資料將晶圓製造、封裝與測試都列為服務環節,也介紹多晶粒(chiplet)如何組合不同功能的晶粒;可參考Intel Foundry 先進封裝與測試說明。然而,封裝方式是否適合,仍取決於晶片架構、散熱、成本、可用產能與產品驗證要求。
晶圓代工是半導體產業的製造服務:晶片設計公司定義電路,代工廠用晶圓與製程把電路做出來,後段再由製造商或封裝測試服務完成晶粒測試、封裝與交付。AI 晶片與手機晶片都仰賴這套製造鏈,但兩類產品的設計目標、製程選擇和封裝需求不同。理解新聞時,應同時看設計分工、製程平台、良率、產能和封裝,避免把單一節點名稱當成全部答案。
本文以台積電、ASML 與 Intel 的公開技術資料交叉核對產業分工與製程概念。各公司提供的製程名稱、路線圖、量產時間和服務範圍會更新;本文不將特定公司未來承諾視為已實現的產能或效能結果。查詢最新技術資訊時,請以製造商現行技術頁面與產品公告為準。
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